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          標簽 > verilog

          verilog

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          verilog技術

          FPGA中的testbench介紹

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          跟大家解釋一點,所有testbench本質上都是串行執行,因為在CPU環境下,沒有可靠并行執行的能力。所有并行的語句,比如兩個always模塊,fork...

          2018-10-10 標簽:FPGAverilog 161 0

          如何把二進制轉換為格雷碼?格雷碼是如何判斷讀空寫滿呢?

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          在傳遞讀寫時鐘域的指針使用格雷碼來傳遞,如何把二進制轉換為格雷碼,格雷碼是如何判斷讀空寫滿呢?

          2018-09-15 標簽:二進制verilog格雷碼 305 0

          常見的Verilog行為級描述語法

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          常見的Verilog描述語句與對應的邏輯關系;熟悉語法與邏輯之間的關系

          2018-09-15 標簽:VerilogCaseIF 379 0

          FPGA學習verilog代碼的經驗總結

          FPGA學習verilog代碼的經驗總結

          既然HDL設計是并行的,那么就只能各個擊破了。我的習慣是先抓幾個重要端口,比如時鐘(CLK)、復位(RESET)等出現頻率比較高的端口,把它先弄清楚...

          2018-09-14 標簽:fpgaverilog代碼 153 0

          不同verilog代碼的RTL視圖

          不同verilog代碼的RTL視圖

          剛開始玩CPLD/FPGA開發板的時候使用的一塊基于EPM240T100的板子,alter的這塊芯片雖說功耗小體積小,但是資源還是很小的,你寫點稍微復雜...

          2018-09-14 標簽:verilogrtl 122 0

          組合邏輯概述

          組合邏輯概述

          根據狄摩根定律第二條,就可以將積之和布爾表達式轉化成和之積形式;根據狄摩根定律第一條,就可以將和之積布爾表達式轉化成積之和形式。

          2018-09-10 標簽:邏輯電路Verilog 288 0

          數字電路里面有什么元素需要被描述?

          數字電路里面有什么元素需要被描述?

          組合邏輯電路: 可以利用 assign 或者 always @(*) 語句描述。一般復雜的組合邏輯電路利用 always @(*)語句塊描述。如上加法...

          2018-09-07 標簽:邏輯電路Verilog數字電路 424 0

          采用FPGA和單片機結合的等精度原理的測量頻率實現

          采用FPGA和單片機結合的等精度原理的測量頻率實現

          傳統測量頻率的方法主要有直接測量法、分頻測量法、測周法等,這些方法往往只適用于測量一段頻率,當被測信號的頻率發生變化時,測量的精度就會下降。

          2018-08-31 標簽:fpga單片機Verilog 181 0

          使用Verilog來實現EEPROM的讀寫,進行一個簡單的I2C實戰應用

          使用Verilog來實現EEPROM的讀寫,進行一個簡單的I2C實戰應用

          傳送器件地址ID_Address,器件地址的最后一位為數據的傳輸方向位,R/W,低電平0表示主機往從機寫數據(W),1表示主機從從機讀數據(R)。這里按...

          2018-08-31 標簽:VerilogEEPROM 829 0

          用硬件思維去理解verilog

          用硬件思維去理解verilog

          大家也應該知道,在沒有verilog這種高級語言之前都是用原理圖設計,必須先構思好整個電路框架,才能去實現。有了verilog以后這種思路并沒有被拋...

          2018-08-31 標簽:硬件verilog數字電路 445 0

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          verilog資訊

          Ajoy Bose:可重用IP(智能產權)才是新的抽象等級

          Ajoy Bose:可重用IP(智能產權)才是新的抽象等級

          Atrenta公司主席、總裁兼首席執行官Ajoy Bose認為:“可重用IP(智能產權)才是新的抽象等級。

          2018-07-09 標簽:SoCipVerilog 132 0

          基于Verilog實現的DDS任意波形發生器

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          2018-01-08 標簽:Verilog任意波形發生器 685 0

          uart串口代碼verilog

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           Verilog HDL是一種硬件描述語言(HDL:Hardware Description Language),以文本形式來描述數字系統硬件的結構和行...

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          這才是學習FPGA的正確路徑

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          我把FPGA層次劃分為,雞蛋級別,菜鳥級別,老鳥級別,高手級別四類。題主是雞蛋級別的吧!啥也不會。那些得贊高的不少都是菜鳥級別的選手。當然,我現在告訴你...

          2016-06-07 標簽:FPGAVerilog可編程邏輯門陣列 13476 2

          FPGA核心知識詳解(2):FPGA入門書籍推薦篇

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          電子發燒友網核心提示 :對于FPGA初學者而言,正確的入門參考書籍對其至關重要。應廣大FPGA初學者和愛好者要求,電子發燒友網編輯根據多名在FPGA領域...

          2012-11-29 標簽:FPGASOPCVerilog 42143 13

          Altium在Altium Designer軟件內新增Aldec FPGA仿真技術

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          Altium和Aldec簽署的OEM協議中決定將Aldec的FPGA仿真功能添加到Altium Designer軟件中去。該協議的簽署使進行FPGA(現...

          2012-09-20 標簽:FPGAAltiumVerilog 921 0

          FPGA牛人給FPGA初學者入門留下的幾點心得體會

          電子發燒友網訊: 最近有很多FPGA初學者在論壇里咨詢,FPGA初學者應該從哪里開始學起呢?為此,我找了多名做FPGA相關工作的的前輩請教,從而對FPG...

          2012-09-13 標簽:FPGAverilogVHDL 3695 1

          Verilog代碼命名六大黃金規則

          電子發燒友網核心提示: 關于Verilog代碼中命名的六大黃金規則。 1. 系統級信號的命名。 系統級信號指復位信號,置位信號,時鐘信號等需要輸送到各個...

          2012-09-04 標簽:Verilog代碼 1432 1

          VerilogHDL綜合性設計

          介紹利用自動化綜合工具在編碼和綜合的階段完成用于HDTV芯片設計的優化

          2012-06-15 標簽:VerilogVerilogHDL 634 0

          Verilog代碼覆蓋率檢查

          Verilog代碼覆蓋率檢查是檢查驗證工作是否完全的重要方法,代碼覆蓋率(codecoverge)可以指示Verilog代碼描述的功能有多少在仿真過程中...

          2012-04-29 標簽:Verilog代碼覆蓋率 2518 1

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          • 靜電防護
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          時鐘 時鐘振蕩器 時鐘發生器 時鐘緩沖器 定時器 寄存器 實時時鐘 PWM 調制器
          視頻放大器 功率放大器 頻率轉換器 揚聲器放大器 音頻轉換器 音頻開關 音頻接口 音頻編解碼器
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